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boards:lopht [2020/07/17 12:32] – darronboards:lopht [2021/11/01 16:11] (current) – [Pickle ICSP] darron
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 <code> <code>
-              +------------+ +                     +------------+ 
-RP4   RA3  A3 |            | A2  RA2   RP3 +OSC2   RP4   RA3  A3 |            | A2  RA2  RP3  OSC1 
-RP10  RB4  B4 |            | SC  SCL2 +SOSCI  RP10  RB4  B4 |            | SC  RB3  RP9  SCL2  
-RP5   RA4  A4 |            | SD  SDA2 +SOSCO  RP5   RA4  A4 |            | SD  RB2  RP8  SDA2 
-RP11  RB4  B5 |            | B1  RB1   RP7 +PGED3  RP11  RB5  B5 |            | B1  RB1  RP7  PGEC1 
-RP12  RB7  B7 |            | B0  RB0   RP6 +       RP12  RB7  B7 |            | B0  RB0  RP6  PGED1 
-RP18  RC9  C9 |            | EN  !MCLR +PGEC3  RP18  RC9  C9 |            | EN  !MCLR 
-          3V3 |            | 3V3 +                 3V3 |            | 3V3 
-          GND |            | 0V  GND +                 GND |            | 0V  GND 
-           5V |            | 5V +                  5V |            | 5V 
-         SBU2 |    USBC    | SBU1 +                SBU2 |    USBC    | SBU1 
-              +------------++                     +------------+
 </code> </code>
  
 ==Red== ==Red==
 <code> <code>
 +                     +------------+
 +             GND  0V |            | 5V
 +OSC1   RP3   RA2  A2 |            | SC  RB3  RP9  SCL2
 +OSC2   RP4   RA3  A3 |            | SD  RB2  RP8  SDA2
 +SOCSI  RP10  RB4  B4 |            | B1  RB1  RP7  PGEC1
 +SOSCO  RP5   RA4  A4 |            | B0  RB0  RP6  PGED1
 +PGED3  RP11  RB5  B5 |            | PC  RA0  RP1  PGEC2
 +       RP12  RB7  B7 |            | PD  RA1  RP2  PGED2
 +       RP13  RB8  B8 |            | 0V  GND
 +       RP14  RB9  B9 |            | 3V3
 +PGEC3  RP18  RC9  C9 |    USBC    | EN  !MCLR
 +                     +------------+
 +</code>
  
 +===Pickle ICSP===
 +<wrap right>
 +{{:boards:lophticsp.jpg?200}}
 +{{:boards:lophticsp2.jpg?200}}
 +</wrap>
 +<code>
 +$ cat ~/.pickle/config
 +DEVICE=RPI0
 +SLEEP=1
 +# 0x0100 PGD_RELEASE
 +# 0x0200 PGC_RELEASE
 +# 0x0400 PGM_RELEASE
 +# 0x0800 VPP_RELEASE
 +BITRULES=0x0F00
 +VPP=21
 +PGD=20
 +PGC=16
 +PGM=-1
 </code> </code>
  
 +==Green==
 +<code>
 +$ p32 id
 +[1D000000] [PROGRAM]  00010000 WORDS
 +[1F803660] [DEVICEID] 27718053 VER:2 DEV:7718 MAN:053 PIC32MM0256GPM028
 +[1FC00000] [BOOT]     00000600 WORDS
 +[1FC017C0] [RESERVED] FFFFFFFF
 +[1FC017C4] [FDEVOPT]  FFFF3FFF
 +[1FC017C8] [FICD]     FFFFFFFB
 +[1FC017CC] [FPOR]     FFFFFFFF
 +[1FC017D0] [FWDT]     FFFF74F4
 +[1FC017D4] [FOCSEL]   FFFFEF38
 +[1FC017D8] [FSEC]     FFFFFFFF
 +[1FC017DC] [RESERVED] FFFFFFFF
 +[1FC017E0] [FSIGN]    7FFFFFFF
 +[1FC017E4] [RESERVED] FFFFFFFF
 +           [PE]       RIPE_20a_000510.bin
 +</code>
 +
 +==Red==
 +
 +<code>
 +$ p32 id
 +[1D000000] [PROGRAM]  00010000 WORDS
 +[1F803660] [DEVICEID] 37718053 VER:3 DEV:7718 MAN:053 PIC32MM0256GPM028
 +[1FC00000] [BOOT]     00000600 WORDS
 +[1FC017C0] [RESERVED] FFFFFFFF
 +[1FC017C4] [FDEVOPT]  FFFF3FFF
 +[1FC017C8] [FICD]     FFFFFFFB
 +[1FC017CC] [FPOR]     FFFFFFFF
 +[1FC017D0] [FWDT]     FFFF74F4
 +[1FC017D4] [FOCSEL]   FFFFEF38
 +[1FC017D8] [FSEC]     FFFFFFFF
 +[1FC017DC] [RESERVED] FFFFFFFF
 +[1FC017E0] [FSIGN]    7FFFFFFF
 +[1FC017E4] [RESERVED] FFFFFFFF
 +           [PE]       RIPE_20a_000510.bin
 +</code>
 ===Resources=== ===Resources===
  
-https://github.com/lophtware/UsbCPic32Breakout/wiki/Schematics.pdf+[[https://github.com/lophtware/UsbCPic32Breakout/wiki|Documentation]] 
 + 
 +[[https://github.com/lophtware/UsbCPic32Breakout/wiki/Schematics.pdf|Schematic]] 
 + 
 +[[https://www.onsemi.com/pub/Collateral/NCP367-D.PDF|Power management]] 
 + 
 +[[http://ww1.microchip.com/downloads/en/DeviceDoc/PIC32MM0256GPM064-Family-Data-Sheet-DS60001387D.pdf|CPU]]